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         在PCB设计中,通常认为数字逻辑电路的频率如果达到或超过45MHZ~50MHZ,且工作在这个频率之上的电路已占到了整个电子系统一定份量(如1/3),那么就称之为高速电路。
         随着系统设计复杂性和集成度的大规模提高,电子系统设计师们正在从事100MHZ以上的电路设计,总线的工作频率也已经达到或者超过50MHZ,有的甚至超过100MHZ。目前约50% 的设计的时钟频率超过50MHz,将近20% 的设计主频超过120MHz。

          高速PCB设计是随着系统设计复杂性和集成度的大规模提高发展起来的,原因是:
         1.当系统工作在50MHz时,将产生传输线效应和信号完整性问题,
         2.而当系统工作达到120MHz时,除非使用高速电路设计知识,否则基于传统方法设计的PCB将无法工作。所以,高速电路设计技术已经成为电子系统设计师必须采取的设计手段。
        实际上,信号边沿的谐波频率比信号本身的频率高,是信号快速变化的上升沿与下降沿(或称信号的跳变)引发了信号传输的非预期结果。因此,通常约定如果线传播延时大于1/2数字信号驱动端的上升时间,则认为此类信号是高速信号并产生传输线效应。信号的传递发生在信号状态改变的瞬间,如上升或下降时间。信号从驱动端到接收端经过一段固定的时间,如果传输时间小于1/2的上升或下降时间,那么来自接收端的反射信号将在信号改变状态之前到达驱动端。反之,反射信号将在信号改变状态之后到达驱动端。如果反射信号很强,叠加的波形就有可能会改变逻辑状态。
         因此,我们在设计中,权衡各种因素,做出全面的折衷考虑:既满足高速PCB设计要求,又降低设计复杂难度。
    我们对高速PCB设计手段的采用,构成了设计过程的可控性,只有可控的,才是可靠的,也才会是成功的! 

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